正社員
掲載予定期間：2024/2/15(木)〜2024/5/15(水)
【群馬/館林】半導体試験装置のFPGA論理回路設計※リモート可／プロトコル規格対応の開発PJT
【半導体試験装置世界トップ級シェア／開発PJTにおけるFPGA設計担当／リモート勤務・フレックス有／熊谷・館林近く※マイカー通勤可】
■担当業務：
半導体試験装置でグローバルトップシェアを誇る同社において、高速プロトコルNANDフラッシュ・メモリのテスタ開発における、FPGA論理回路設計をお任せします。
具体的には…
・システム・レベル・テスタ向けFPGA開発
・メイン業務は論理回路設計（Verilog HDL, System Verilog）、検証・評価プログラム作成（C++）
※通常は3－5人程度のチームでコミュニケーションをとりながら開発いただきます。
■業務の魅力・やりがい：
・UFS、UniPro、MIPI M-PHY、PCIeなど、高速プロトコル規格への対応必要性があり、その都度改良開発を行います。場合によっては一部だけの改良ではなく、大枠を作り変えることも有り、非常にチャレンジングな業務となっています。
■配属組織：
・本部門は群馬R&Dセンターに5名、海外拠点にも複数名開発者が在籍しています。
・適宜海外の開発拠点とも、図面や資料を用いてコラボしながら開発を進めていただきます。(現時点で英語力必須ではありません)
■働き方：
・月平均残業20‐30h程度で、リモートワークやフレックスも活用中です。
・同社は群馬、栃木、埼玉の県境付近に位置しており、熊谷や館林からも通いやすい環境です。マイカー通勤可能。
■同社について：
同社は2018年「世界のテクノロジー・リーダー上位100社」に選ばれており、日本企業からは当社を含む13社が選ばれています。積極的に海外工場とも関係を築いており、多様なスキルを積むことが可能です。
同社の半導体試験装置は、世界的トップシェアを誇っています。試験装置ならではのノウハウを長年蓄積し、世界レベルの高性能、高機能の製品を製造してきました。新製品の開発に対しても積極的で、今後も更なる製品の品質向上に取り組んでおります。
【チーム／組織構成】
【その他製品・プロジェクト事例】
【利用するツール・ソフト等】
| 募集職種 |
技術職（電気、電子、機械） > 回路・システム設計 > 回路設計（デジタル） 技術職（電気、電子、機械） > 半導体設計 > デジタルIC設計（メモリ） |
|---|---|
| 雇用形態 | 正社員
＜雇用形態補足＞ 期間の定め：無 ＜試用期間＞ 3ヶ月 |
| 勤務時間 | ＜労働時間区分＞ フレックスタイム制 コアタイム：11:00～14:00 フレキシブルタイム：6:00～11:00、14:00～22:00 休憩時間：60分（12:00～13:00） 時間外労働有無：有 ＜標準的な勤務時間帯＞ 8:45～17:30 |
| 勤務地 | ＜勤務地詳細＞ 群馬R&Dセンタ 住所：群馬県邑楽郡明和町大輪336-1 勤務地最寄駅：東武伊勢崎線／川俣駅 受動喫煙対策：屋内全面禁煙 |
| 交通 | ＜転勤＞ 当面なし 転勤は当面ございません。 ＜在宅勤務・リモートワーク＞ 相談可（週3日リモート） ＜オンライン面接＞ 可 |
| 給与 | ＜予定年収＞ 650万円～1,100万円 ＜賃金形態＞ 月給制 ＜賃金内訳＞ 月額（基本給）：400,000円～600,000円 ＜月給＞ 400,000円～600,000円 ＜昇給有無＞ 有 ＜残業手当＞ 有 ＜給与補足＞ ※スキル・経験等により個別に設定させていただきます。 ■昇給 ： 年1回（6月） ■賞与 ： 年2回（6月、12月）※2ｹ月分×2回＝約４ｶ月分想定 賃金はあくまでも目安の金額であり、選考を通じて上下する可能性があります。 月給(月額)は固定手当を含めた表記です。 |
| 待遇・福利厚生 | 通勤手当、住宅手当、寮社宅、健康保険、厚生年金保険、雇用保険、労災保険、厚生年金基金、退職金制度 ＜各手当・制度補足＞ 通勤手当：全額支給 住宅手当：家賃補助制度 寮社宅：借上社宅制度 社会保険：■各種保険完備 厚生年金基金：アドバンテスト厚生年金基金 退職金制度：補足事項なし ＜定年＞ 60歳 ＜教育制度・資格補助補足＞ ■OJT ■教育補助制度あり、その他各種英語研修、社内TOEIC(R)テストなど ＜その他補足＞ 各種社会保険、健康保険組合、企業年金基金、確定拠出年金、従業員持株制度、財形貯蓄制度、再雇用制度、育児休職制度、家賃補助制度、借上社宅制度、借上寮制度など |
| 休日・休暇 | 【休日・休暇】 完全週休2日制（休日は土日祝日） 年間有給休暇1日～22日（下限日数は、入社直後の付与日数となります） 年間休日日数129日 ■2021年度実績 GW（7日）／夏季休暇（9日）／年末年始（7日） 入社月に応じ1～22日を付与します |
| 応募資格 | ＜最終学歴＞大学院、大学卒以上 ＜応募資格/応募条件＞ ■必須条件： ・FPGA（言語Verilog, System Verilog）設計経験をお持ちの方 ・プロトコル規格への対応経験があれば、LSI回路設計経験者の方も歓迎 ■歓迎要件： ・UFS、UniPro、MIPI M-PHY、PCIeなど、高速プロトコル規格に精通している方 |
|---|---|
| 応募方法 | このページ内の「応募」ボタンよりご応募ください。 |
| 選考プロセス | - |
| 会社名称 | 株式会社 アドバンテスト |
|---|---|
| 所在地 | 〒100-0005 東京都千代田区丸の内1-6-2 新丸の内センタービルディング |
| 事業内容 | ■事業内容 半導体・部品テストシステム事業、メカトロニクス関連事業、サービス他 |
| 代表者 | - |
| URL | https://www.advantest.com/ja/home |
| 設立 | 年1954年12月 |
| 資本金 | 32,363百万円 |
| 売上 | 560,191百万円 |
| 従業員数 | 7,117名 |
| 平均年齢 | 46.1歳 |
| 主要取引先 | - |
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