正社員
【職務概要】
半導体製品(デジタル/アナログ)の開発におけるフロントエンド、ミドルエンド、バックエンドの設計に及ぶテスト/法科業務等、ご経験や適性に応じていずれかお任せいたします。
【職務詳細】
■プレイヤー業務
デジタル:RTL設計/検証/タイミング検証/STA/DFT/P&R/インプリ/FPGA
アナログ:各種アナログIP設計/レイアウト/実験評価 等
■マネジメント業務
メンバー育成:モチベーション管理及び、技術向上に向けて、オンラインや対面でコミュニケーションを取っていただきます
★備考--------------------------------
プロジェクト先に常駐して就業して頂きます。
主な常駐先は、ルネサスエレクトロニクス、ソニー、日立、東芝、キヤノン等大手半導体メーカーが中心です。
大手メーカー出身のベテランエンジニアからOJTを受けることができます。
募集職種 |
技術職(電気、電子、機械) > 半導体設計 > アナログ・高周波IC設計 |
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雇用形態 | 正社員 |
勤務時間 | - |
勤務地 | 東京都大田区羽田空港1-1-4羽田イノベーションシティZoneK2F 京急空港線東京モノレール「天空橋」駅直結 |
交通 | - |
給与 | 年収 800万円~1000万円 |
待遇・福利厚生 | ■年収:800万~1200万円 月給制:月額614500円 賞与:年2回 昇給:有 ■雇用形態:正社員 契約期間:無期 試用期間:有(6ヶ月(条件変更なし)) ■福利厚生: 通勤手当、引っ越し手当(規定有り)、転居支度金制度、退職金制度、産休・育休制度等 ■勤務時間:9:00~18:00 休憩時間:60分 ■喫煙情報:屋内禁煙 |
休日・休暇 | 年間124日、土日休み、祝日休み、年末年始、夏期休暇、特別休暇等 |
応募資格 | 【必須】 ・デジタルまたはアナログの設計経験 ・下記いずれかの使用経験 VerilogHDL、SystemVerilog、NC-Verilog、VCS、Design Compiler、DFT、Prime time、Quatus、Vivado、Virtuoso、Calibre、Spice、Perl、Tcl 45歳以下 【年齢制限理由】 長期勤続によるキャリア形成を図る観点から、若年者等を期間の定めのない労働契約の対象として募集・採用するため |
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応募方法 | このページ内の「応募」ボタンよりご応募ください。
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選考プロセス | - |
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