正社員
【パソナキャリア経由での入社実績あり】
2nm世代、及びBeyond 2nmの先端ロジック開発におけるTEGレイアウト設計を担っていただきます。
■デバイス技術者、プロセスインテグレーション技術者、社内エキスパート（PDK、パッケージング）との連携を図り、効果的な技術開発をリードいただきます。
■半導体TEGレイアウト設計、Kerf設計、Mark設計を主業務とし、より高度な2nm世代、Beyond 2nm世代の技術開発基盤を支える創造的TEG設計に従事していただきます。
【定年】65 歳
※65 歳以降有期契約による継続雇用有
【同社とは】
この度2027年に次世代半導体生産を目指し、キャリア採用を加速させております。
| 募集職種 |
技術職（電気、電子、機械） > 半導体設計 > デジタルIC設計（メモリ） 技術職（電気、電子、機械） > 生産技術、製造技術、プロセス開発 > 生産技術、製造技術、プロセス開発（家電・AV・コンピュータ関連） |
|---|---|
| 雇用形態 | 正社員 |
| 勤務時間 | - |
| 勤務地 | 北海道 |
| 交通 | - |
| 給与 | 年収 400万円～900万円 |
| 待遇・福利厚生 | 経験・スキルに応じて変動します |
| 休日・休暇 | 完全週休二日(土日) |
| 応募資格 | 【必須要件】 ■半導体TEGレイアウト設計（デジタル回路論理設計、レイアウト設計、設計フロー構築、自動配置配線ツール、PCell （Parameterized Cell） 設計）、デバイス開発、プロセスインテグレーション開発のいずれかのご経験 ■TOEIC 600点以上もしくは同等程度の語学力 ■日本語 JLPT: N3取得済み、もしくは同等程度の語学力 |
|---|---|
| 応募方法 | このページ内の「応募」ボタンよりご応募ください。
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| 選考プロセス | - |
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