| 仕事内容 | 半導体の設計エンジニアとして以下の業務を行って頂きます。 ● アナログまたはディジタルIPデザイン及び検証 ● Mixed IP、 FBE（Front/Back－End）、 PKG、 SI（Signal Integrity） /PI（Power Integrity）、 本社評価TeamまたはIP設計Teamとの協力設計 ● 継続的な設計品質改善活動 ● その他、顧客からの要求事項 |
|---|---|
| 応募資格 | ＜必須＞ ●verilogの経験 ● デジタルロジックの設計経験が5年以上ある方 ● 大学卒以上 35歳以上52歳以下 【年齢制限理由】 長期勤続によるキャリア形成を図る観点から、若年者等を期間の定めのない労働契約の対象として募集・採用するため |
| 給与 | 年収 600万円～800万円 |
| 勤務地 | 東京都千代田区 最寄り駅：大手町駅から直結／東京駅から徒歩5分 |
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| 仕事内容 | 半導体の設計エンジニアとして以下の業務を行って頂きます。 ● アナログまたはディジタルIPデザイン及び検証 ● Mixed IP、 FBE（Front/Back－End）、 PKG、 SI（Signal Integrity） /PI（Power Integrity）、 本社評価TeamまたはIP設計Teamとの協力設計 ● 継続的な設計品質改善活動 ● その他、顧客からの要求事項 |
|---|---|
| 応募資格 | ＜必須＞ ●virtuosoの経験 ●アナログまたはディジタルIPデザイン設計の経験が5年以上ある方 ● 大学卒以上 35歳以上52歳以下 【年齢制限理由】 長期勤続によるキャリア形成を図る観点から、若年者等を期間の定めのない労働契約の対象として募集・採用するため |
| 給与 | 年収 800万円～1100万円 |
| 勤務地 | 東京都千代田区 最寄り駅：大手町駅から直結／東京駅から徒歩5分 |
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| 仕事内容 | 半導体の設計エンジニアとして以下の業務を行って頂きます。 ● アナログまたはディジタルIPデザイン及び検証 ● Mixed IP、 FBE（Front/Back－End）、 PKG、 SI（Signal Integrity） /PI（Power Integrity）、 本社評価TeamまたはIP設計Teamとの協力設計 ● 継続的な設計品質改善活動 ● その他、顧客からの要求事項 |
|---|---|
| 応募資格 | ＜必須＞ ●virtuosoの経験 ●アナログまたはディジタルIPデザイン設計の経験が5年以上ある方 ● 大学卒以上 35歳以上52歳以下 【年齢制限理由】 長期勤続によるキャリア形成を図る観点から、若年者等を期間の定めのない労働契約の対象として募集・採用するため |
| 給与 | 年収 800万円～1100万円 |
| 勤務地 | 東京都千代田区 最寄り駅：大手町駅から直結／東京駅から徒歩5分 |
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転職したいけど、求人を探す時間がない人は、| 仕事内容 | 半導体の設計エンジニアとして以下の業務を行って頂きます。 ● アナログまたはディジタルIPデザイン及び検証 ● Mixed IP、 FBE（Front/Back－End）、 PKG、 SI（Signal Integrity） /PI（Power Integrity）、 本社評価TeamまたはIP設計Teamとの協力設計 ● 継続的な設計品質改善活動 ● その他、顧客からの要求事項 |
|---|---|
| 応募資格 | ＜必須＞ ●verilogの経験 ● デジタルロジックの設計経験が5年以上ある方 ● 大学卒以上 35歳以上52歳以下 【年齢制限理由】 長期勤続によるキャリア形成を図る観点から、若年者等を期間の定めのない労働契約の対象として募集・採用するため |
| 給与 | 年収 600万円～800万円 |
| 勤務地 | 東京都千代田区 最寄り駅：大手町駅から直結／東京駅から徒歩5分 |
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| 仕事内容 | ＊担当業務 ・ドキュメントスキャナ回路設計（５年以上） ・マイコンファーム設計 ・FPGA等論理回路設計 |
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| 応募資格 | ＊事務機ほか、比較的小型な量産品などの経験 ＊製品開発経験（１０年程度） |
| 給与 | |
| 勤務地 | 東京本社 |
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