| 仕事内容 | ■期待する役割 デジタル回路設計業務、verilog-HDLによる設計および検証（波形目視のほか、リファレンスCによる一致検証、アサーション検証、カバレッジ検証）。 設計後は測定及び評価チームと協業すると共に、自社工場があるので試作立ち上げのサポートも行います。一方で長期スパンでは次世代CMOSイメージセンサの開発検討も行います。 ■組織としての担当業務 CMOSイメージセンサのデジタル回路設計 |
|---|---|
| 応募資格 | 【必須要件】 ■半導体のデジタル回路設計スキル。具体的にはVerilog-HDL等の上流設計スキルとSRAM等のメモリを制御する為のデジタル回路設計スキル、及びUnix/LinuxのOSを使いこなせる方。 ※半導体の種類は問いません。 |
| 給与 | |
| 勤務地 | 神奈川県厚木市 |
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| 仕事内容 | イメージセンサーデバイス研究開発におけるデバイスエンジニア/プロセスインテグレーター、トランジスタ開発エンジニア、画素設計エンジニア、光学設計エンジニア、画像処理AIエンジニアをそれぞれ募集します。 新規イメージセンサーやセンシングデバイスを実現するため、センサー構造の企画構想、デバイス構造設計、プロセスフロー設計、センサー特性評価業務などを行います。 ■組織としての担当業務 裏面照射型、積層型 |
|---|---|
| 応募資格 | 【必須要件】 以下いずれかに該当 ・半導体物性、物理学、電子工学、電気工学など基礎的な知識をお持ちの方 ・イメージセンサー画素開発、電子デバイス開発、シミュレーターによる設計、イメージセンサーの評価、アナログ回路設計、光学素子開発等の経験 ・トランジスタ開発の経験者 ・デバ... |
| 給与 | |
| 勤務地 | 神奈川県厚木市 |
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| 仕事内容 | ■商談獲得に向けたアクション、特に要求仕様の確認、技術提案、プロモーションを実施し、商談獲得に結びつける先導役。BUの重点課題である、商談獲得の強化において重要な役割を担うことを想定。 ■開発フェーズにおいて関係部門と調整を行い、技術課題、開発収支の予実管理、損益上の課題の早期発見、解決を進め、計画通りの開発を推進する。また、改善を仕組化して開発効率化に中心メンバとして貢献する。 ■専門知識、経験 |
|---|---|
| 応募資格 | 【必須要件】 ■LSIの設計/開発マネジメント ■開発収支の予実管理、改善活動 ■英語でのコミュニケーション（海外プロジェクト遂行） 【歓迎要件】 ・LSIの設計経験（フロントエンド、バックエンド） ・マーケティング |
| 給与 | 年収 1000万円～1200万円 |
| 勤務地 | 神奈川県 |
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転職したいけど、求人を探す時間がない人は、| 仕事内容 | ◆LED・半導体レーザー（LD）前工程/後工程の工程設計 ⇒量産プロセス構築にむけた工程検証/条件出し/評価 ⇒画像検査の環境構築/設定 ※量産設備の立上げ含む |
|---|---|
| 応募資格 | 【必須要件】 以下の様な実務経験が1年以上ある方 ■光半導体・半導体関連の技術/開発業務経験 ■自動外観検査の技術/開発業務経験 ■Visual Studio等の開発環境を用いたプログラミング業務経験 ■実験計画立案、検証データまとめ/分析をパワーポイント等を使用して作成出... |
| 給与 | 年収 450万円～1000万円 |
| 勤務地 | 神奈川県 |
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| 仕事内容 | ◆LED・半導体レーザー（LD）前工程/後工程の工程設計 ⇒量産プロセス構築にむけた工程検証/条件出し/評価 ⇒画像検査の環境構築/設定 ※量産設備の立上げ含む |
|---|---|
| 応募資格 | 【必須要件】 以下の様な実務経験が1年以上ある方 ■光半導体・半導体関連の技術/開発業務経験 ■自動外観検査の技術/開発業務経験 ■Visual Studio等の開発環境を用いたプログラミング業務経験 ■実験計画立案、検証データまとめ/分析をパワーポイント等を使用して作成出... |
| 給与 | 年収 250万円～300万円 |
| 勤務地 | 神奈川県 |
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| 仕事内容 | ■System Verilog/Verilog-HDLによる機能検証（アサーション検証、カバレッジ検証 ■リファレンスCによる一致検証などの検証自動化が主体）やミックスシグナル回路の検証 ■ツールベンダや社内有識者との情報共有や協業 ■設計後は測定及び評価チームと協業すると共に、自社工場があるので試作立ち上げのサポート ■開発難易度に応じ、数名～数十名程度のチームを作って要求仕様から検証仕様に落と |
|---|---|
| 応募資格 | 【必須要件】 ■半導体のロジック回路の設計・検証業務を経験されている方。 ■System Verilog またはVerilog-HDLの知見をお持ちの方 ※半導体の種類は問いません。 【歓迎要件】 ・SystemVerilog、UVM、SystemC、アサーション記述、... |
| 給与 | |
| 勤務地 | 神奈川県厚木市 |
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| 仕事内容 | イメージセンサーやディスプレイ開発におけるユニットプロセス構築やプロセス設計シミュレーションを担っていただきます。 新規装置や新規材料（前工程、カラーフィルタ、レンズ用レジスト、研磨スラリー等）の導入、新規プロセス立ち上げ、プロセス設計シミュレーションを担当いただき、次世代のイメージセンサーやディスプレイデバイスを支える基幹技術になりえるものを一緒に創り上げていくことがミッションです。 ※勤 |
|---|---|
| 応募資格 | 【必須要件】 ■ユニットプロセス（シミュレーション（プラズマ、流体、ウエハプロセス設計等）リソグラフィ、ドライエッチング、成膜、洗浄、ダイシング、めっき、CMP/研磨等）構築経験 ※デバイスメーカー・製造装置メーカー・材料メーカーいずれのバッググランドの方も歓迎 ■製造... |
| 給与 | |
| 勤務地 | 神奈川県厚木市 |
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| 仕事内容 | 富士フイルムで開発している医療機器（内視鏡やX線など）、商用プリンタ、生化学分析装置、デジタルカメラに搭載されるFPGA開発のプロジェクト推進サブリーダーをご担当いただきます。 【採用背景】 富士フイルムグループでは、商用プリンタやデジカメ、内視鏡など様々な分野でFPGAを活用しています。各事業の拡大・開発強化のため、将来的にFPGAデジタル回路開発を担っていただく設計リーダー候補を募集します。 |
|---|---|
| 応募資格 | 【必須要件】 ■FPGA/ASIC開発の機能仕様・基本設計の経験 【歓迎要件】 ■数名の小規模プロジェクトのマネジメント経験 ※技術キーワード Xilinx社またはIntel社のFPGA、Verilog-HDL、EDAツール（RTLシミュレーション・静的解析）、画像... |
| 給与 | 年収 600万円～900万円 |
| 勤務地 | 神奈川県足柄上郡 |
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